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diff --git a/drivers/ram/k3-j721e/lpddr4_data_slice_2_macros.h b/drivers/ram/k3-j721e/lpddr4_data_slice_2_macros.h index 7c3756ca85..7ace5fa1c1 100644 --- a/drivers/ram/k3-j721e/lpddr4_data_slice_2_macros.h +++ b/drivers/ram/k3-j721e/lpddr4_data_slice_2_macros.h @@ -10,8 +10,8 @@ #ifndef REG_LPDDR4_DATA_SLICE_2_MACROS_H_ #define REG_LPDDR4_DATA_SLICE_2_MACROS_H_ -#define LPDDR4__DENALI_PHY_512_READ_MASK 0x000F07FFU -#define LPDDR4__DENALI_PHY_512_WRITE_MASK 0x000F07FFU +#define LPDDR4__DENALI_PHY_512_READ_MASK 0x000F07FFU +#define LPDDR4__DENALI_PHY_512_WRITE_MASK 0x000F07FFU #define LPDDR4__DENALI_PHY_512__PHY_CLK_WR_BYPASS_SLAVE_DELAY_2_MASK 0x000007FFU #define LPDDR4__DENALI_PHY_512__PHY_CLK_WR_BYPASS_SLAVE_DELAY_2_SHIFT 0U #define LPDDR4__DENALI_PHY_512__PHY_CLK_WR_BYPASS_SLAVE_DELAY_2_WIDTH 11U @@ -24,8 +24,8 @@ #define LPDDR4__PHY_IO_PAD_DELAY_TIMING_BYPASS_2__REG DENALI_PHY_512 #define LPDDR4__PHY_IO_PAD_DELAY_TIMING_BYPASS_2__FLD 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