/* * Copyright 2019 NXP * * SPDX-License-Identifier: BSD-3-Clause */ #ifndef IMX_DDRC_H #define IMX_DDRC_H #define DDRC_IPS_BASE_ADDR(X) (0x3d400000 + (X * 0x2000000)) #define DDRC_DDR_SS_GPR0 0x3d000000 /* DWC ddr umctl2 REGs offset*/ /**********************/ #define DDRC_MSTR(X) (DDRC_IPS_BASE_ADDR(X) + 0x00) #define DDRC_STAT(X) (DDRC_IPS_BASE_ADDR(X) + 0x04) #define DDRC_MSTR1(X) (DDRC_IPS_BASE_ADDR(X) + 0x08) #define DDRC_MRCTRL0(X) (DDRC_IPS_BASE_ADDR(X) + 0x10) #define DDRC_MRCTRL1(X) (DDRC_IPS_BASE_ADDR(X) + 0x14) #define DDRC_MRSTAT(X) (DDRC_IPS_BASE_ADDR(X) + 0x18) #define DDRC_MRCTRL2(X) (DDRC_IPS_BASE_ADDR(X) + 0x1c) #define DDRC_DERATEEN(X) (DDRC_IPS_BASE_ADDR(X) + 0x20) #define DDRC_DERATEINT(X) (DDRC_IPS_BASE_ADDR(X) + 0x24) #define DDRC_MSTR2(X) (DDRC_IPS_BASE_ADDR(X) + 0x28) #define DDRC_PWRCTL(X) (DDRC_IPS_BASE_ADDR(X) + 0x30) #define DDRC_PWRTMG(X) (DDRC_IPS_BASE_ADDR(X) + 0x34) #define DDRC_HWLPCTL(X) (DDRC_IPS_BASE_ADDR(X) + 0x38) #define DDRC_HWFFCCTL(X) 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